digitaljs

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JavaScript实现的数字电路模拟与教学平台

DigitalJS是一个基于JavaScript的数字电路模拟器,可模拟Yosys等工具合成的电路,并提供配套的转换工具。作为教学平台,它强调代码可读性和易于检查。支持多种数字电路元件,采用JSON格式描述电路。DigitalJS提供在线试用,也可集成到其他项目中。该项目旨在成为一个实用且易用的数字电路设计与学习工具。

DigitalJS数字电路模拟器JavaScript硬件设计YosysGithub开源项目

DigitalJS

这是一个用JavaScript实现的数字电路模拟器项目。

它旨在模拟由硬件设计工具(如Yosys,GitHub仓库在这里)合成的电路,并有一个配套项目yosys2digitaljs,用于将Yosys的输出文件转换为DigitalJS格式。该项目也意在成为一个教学工具,因此可读性和易于检查是项目的首要考虑因素之一。

你可以在线试用。这个网页应用是一个单独的GitHub项目

使用方法

你可以通过从NPM安装来在你的项目中使用DigitalJS:

npm install digitaljs

或者你可以直接使用Webpack打包文件

要模拟使用JSON输入格式(稍后描述)表示的电路,并将其显示在名为#paperdiv上,你需要运行以下JavaScript代码(查看运行示例):

// 创建模拟对象 const circuit = new digitaljs.Circuit(input_goes_here); // 在#paper上显示 const paper = circuit.displayOn($('#paper')); // 激活实时模拟 circuit.start();

输入格式

电路使用JSON表示。顶层对象有三个键:devicesconnectorssubcircuitsdevices下是构成电路的所有设备列表,以对象形式表示,其中键是(唯一的内部)设备名称。每个设备都有若干属性,以对象形式表示。一个必需的属性是type,用于指定设备类型。设备示例:

"dev1": { "type": "And", "label": "AND1" }

connectors下是设备端口之间的连接列表,以对象数组形式表示,每个对象有两个键:fromto。这两个键都映射到一个包含idport两个键的对象;前者对应设备名称,后者对应该设备的有效端口名称。连接必须从输出端口连接到输入端口,且两个端口的位宽必须相等。连接示例:

{ "from": { "id": "dev1", "port": "out" }, "to": { "id": "dev2", "port": "in" } }

subcircuits下是子电路定义列表,以对象形式表示,其中键是唯一的子电路名称。子电路名称可以用作类型为Subcircuit的设备的celltype;这会实例化该子电路。子电路定义遵循整个电路的表示方式,但子电路(目前)不能定义自己的子电路。子电路可以包含InputOutput设备,这些设备会映射到子电路实例的端口。

器件类型

  • 一元门:Not(非门)、Repeater(中继器)
  • 属性:bits(自然数)
  • 输入:inbits位)
  • 输出:outbits位)
  • N元门:And(与门)、Nand(与非门)、Or(或门)、Nor(或非门)、Xor(异或门)、Xnor(同或门)
  • 属性:bits(自然数)、inputs(自然数,默认为2)
  • 输入:in1in2 ... inNbits位,N = inputs
  • 输出:outbits位)
  • 归约门:AndReduceNandReduceOrReduceNorReduceXorReduceXnorReduce
  • 属性:bits(自然数)
  • 输入:inbits位)
  • 输出:out(1位)
  • 位移:ShiftLeft(左移)、ShiftRight(右移)
  • 属性:bits.in1bits.in2bits.out(自然数),signed.in1signed.in2signed.outfillx(布尔值)
  • 输入:in1bits.in1位)、in2bits.in2位)
  • 输出:outbits.out位)
  • 比较器:Eq(等于)、Ne(不等于)、Lt(小于)、Le(小于等于)、Gt(大于)、Ge(大于等于)
  • 属性:bits.in1bits.in2(自然数),signed.in1signed.in2(布尔值)
  • 输入:in1bits.in1位)、in2bits.in2位)
  • 输出:out(1位)
  • 数字常量:Constant
  • 属性:constant(二进制字符串)
  • 输出:outconstant.length位)
  • 一元算术运算:Negation(取反)、UnaryPlus(正号)
  • 属性:bits.inbits.out(自然数),signed(布尔值)
  • 输入:inbits.in位)
  • 输出:outbits.out位)
  • 二元算术运算:Addition(加法)、Subtraction(减法)、Multiplication(乘法)、Division(除法)、Modulo(取模)、Power(幂运算)
  • 属性:bits.in1bits.in2bits.out(自然数),signed.in1signed.in2(布尔值)
  • 输入:in1bits.in1位)、in2bits.in2位)
  • 输出:outbits.out位)
  • 多路复用器:Mux
  • 属性:bits.inbits.sel(自然数)
  • 输入:in0 ... inNbits.in位,N = 2**bits.sel-1),selbits.sel位)
  • 输出:outbits.in位)
  • 独热码多路复用器:Mux1Hot
  • 属性:bits.inbits.sel(自然数)
  • 输入:in0 ... inNbits.in位,N = bits.sel),selbits.sel位)
  • 输出:outbits.in位)
  • 稀疏多路复用器:MuxSparse
  • 属性:bits.inbits.sel(自然数),inputs(自然数列表),default_input(可选布尔值)
  • 输入:in0 ... inNbits.in位,N = inputs.length,如果default_input为真则+1)
  • 输出:outbits.in位)
  • D触发器:Dff
  • 属性:bits(自然数),polarity.clockpolarity.arstpolarity.srstpolarity.aloadpolarity.setpolarity.clrpolarity.enableenable_srst(可选布尔值),initial(可选二进制字符串),arst_valuesrst_value(可选二进制字符串),no_data(可选布尔值)
  • 输入:inbits位),clk(1位,如果存在polarity.clock),arst(1位,如果存在polarity.arst),srst(1位,如果存在polarity.srst),en(1位,如果存在polarity.enable),set(1位,如果存在polarity.set),clr(1位,如果存在polarity.clr),ainbits位,如果存在polarity.aload),aload(1位,如果存在polarity.aload
  • 输出:outbits位)
  • 内存:Memory
  • 属性:bitsabitswordsoffset(自然数),rdports(读端口描述符数组),wrports(写端口描述符数组),memdata(内存内容描述)
  • 读端口描述符属性:enable_polarityclock_polarityarst_polaritysrst_polarity(可选布尔值),init_valuearst_valuesrst_value(可选二进制字符串),transparentcollision(可选布尔值或布尔值数组)
  • 写端口描述符属性:enable_polarityclock_polarityno_bit_enable(可选布尔值)
  • 输入(每个读端口):rdKaddrabits位),rdKen(1位,如果存在enable_polarity),rdKclk(1位,如果存在clock_polarity),rdKarst(1位,如果存在arst_polarity),rdKsrst(1位,如果存在srst_polarity
  • 输出(每个读端口):rdKdatabits位)
  • 输入(每个写端口):wrKaddrabits位),wrKdatabits位),wrKen(当no_bit_enable为真时为1位,否则为bits位,如果存在enable_polarity),wrKclk(1位,如果存在clock_polarity
  • 时钟源:Clock
  • 输出:out(1位)
  • 按钮输入:Button
  • 输出:out(1位)
  • 指示灯输出:Lamp
  • 输入:in(1位)
  • 数字输入:NumEntry
  • 属性:bits(自然数),numbase(字符串)
  • 输出:outbits位)
  • 数字输出:NumDisplay
  • 属性:bits(自然数),numbase(字符串)
  • 输入:inbits位)
  • 子电路输入:Input
  • 属性:bits(自然数)
  • 输出:outbits位)
  • 子电路输出:Output
  • 属性:bits(自然数)
  • 输入:inbits位)
  • 七段显示器输出:Display7
  • 输入:bits(仅8位 - 最高有效位控制小数点LED)
  • 总线分组:BusGroup
  • 属性:groups(自然数数组)
  • 输入:in0groups[0]位) ... inNgroups[N]位)
  • 输出:outgroups总和位)
  • 总线解组:BusUngroup
  • 属性:groups(自然数数组)
  • 输入:ingroups总和位)
  • 输出:out0groups[0]位) ... outNgroups[N]位)
  • 总线切片:BusSlice
  • 属性:slice.firstslice.countslice.total(自然数)
  • 输入:inslice.total位)
  • 输出:outslice.count位)
  • 零扩展和符号扩展:ZeroExtendSignExtend
  • 属性:extend.inputextend.output(自然数)
  • 输入:inextend.input位)
  • 输出:outextend.output位)
  • 有限状态机:FSM
  • 属性:bits.inbits.outstatesinit_statecurrent_state(自然数)、trans_table(转换描述符数组)
  • 转换描述符属性:ctrl_inctrl_out(二进制字符串)、state_instate_out(自然数)
  • 输入:clk(1位)、arst(1位)、inbits.in位)
  • 输出:outbits.out位)

待办事项

进一步开发模拟器的一些想法:

  • 使用JointJS elementTools来配置/移除门电路。
  • 支持Verilog格式和Intel HEX的RAM/ROM导入/导出。
  • 添加带字符/位图显示的帧缓冲区元素。
  • 增加更多编辑功能:添加和删除模块,修改部分模块属性。
  • 添加撤销-重做功能。
  • 保存和加载电路,包括布局和状态。
  • 为单目/二目门电路通用处理否定(输入/输出上的否定),以提高清晰度。
  • SVG导出功能。
  • Verilog导出功能。
  • 适配智能手机和平板电脑的用户界面。

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